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3.3V CMOS Static RAM
1 Meg (128K x 8-Bit)
Center Power &
Ground Pinout
IDT71V124SA
128K x 8 advanced high-speed CMOS static RAM
JEDEC revolutionary pinout (center power/GND) for
Equal access and cycle times
One Chip Select plus one Output Enable pin
Inputs and outputs are LVTTL-compatible
Single 3.3V supply
Low power consumption via chip deselect
Available in a 32-pin 300- and 400-mil Plastic SOJ, and
Features
◆
◆
reduced noise
◆
– Commercial: 10/12/15ns
– Industrial: 12/15ns
◆
◆
◆
◆
◆
32-pin Type II TSOP packages.
Functional Block Diagram
A 0
?
?
Description
The IDT71V124 is a 1,048,576-bit high-speed static RAM organized
as 128K x 8. It is fabricated using high-performance, high-reliability CMOS
technology. This state-of-the-art technology, combined with innovative
circuit design techniques, provides a cost-effective solution for high-speed
memory needs. The JEDEC center power/GND pinout reduces noise
generation and improves system performance.
The IDT71V124 has an output enable pin which operates as fast as
5ns, with address access times as fast as 10ns available. All bidirectional
inputs and outputs of the IDT71V124 are LVTTL-compatible and operation
is from a single 3.3V supply. Fully static asynchronous circuitry is used;
no clocks or refreshes are required for operation.
A 16
?
?
ADDRESS
DECODER
?
?
1,048,576-BIT
MEMORY ARRAY
I/O 0 - I/O 7
8
I/O CONTROL
8
.
8
WE
OE
CS
CONTROL
LOGIC
1
3873 drw 01
FEBRUARY 2013
? 2013 Integrated Device Technology, Inc. All rights reserved. Product specifications subject to change without notice.
DSC-3873/11
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